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用VHDL設計實現的有線頂盒信源發生方案

3、系統整體設計
來源:投影時代 更新日期:2008-06-09 作者:佚名
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   3、系統整體設計

    系統啟動后,主機向I/O口發出地址信號。AEN為低電平時,系統進行地址譯碼。譯碼成功后,產生一使能信號ENABLE打開數據暫存單元。數據到來后,數據暫存單元將總線上的16位并行數據鎖存在暫存器中,同時產生一允許信號PERMIT,允許進行數據格式轉換。接下來系統根據當前所處的狀態進行選擇輸出,完成格式的轉換,并產生相應的輸出數據使能信號DEN和輸出數據時鐘信號DCLK。整個過程結束后,將各信號復位,開始新的轉換周期。因此,整個系統應包括五個邏輯部分:地址譯碼、數據暫存、狀態控制、復位控制、轉換輸出。

    3.1系統的整體框圖

    系統的整體框圖如圖2所示。

圖2

圖2

  3.2系統的工作時序

    轉換過程的時序如圖3所示。 

圖3

圖3

 

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